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转载 创建 Vitis 加速平台第 1 部分:在 Vivado 中为加速平台创建硬件工程

作者:Stephen MacMahon来源:赛灵思中文社区论坛在本文中,我们将讲解如何在 Vivado® Design Suite 中完成平台准备工作,以便将其用作为 Vitis™ 中的...

2020-10-30 08:00:00 23

转载 创建 Vitis 加速平台第 3 部分:在 Vitis 中封装加速平台

作者:Stephen MacMahon来源:赛灵思中文社区论坛这是《创建 Vitis 加速平台》系列的第 3 篇博文。在前文中,我们讲解了如何创建硬件和软件工程。在本文中,我们将讲解如何...

2020-10-30 08:00:00 26

转载 创建 Vitis 加速平台第 4部分:在 Vitis 中测试定制加速平台

作者:Stephen MacMahon来源:赛灵思中文社区论坛https://forums.xilinx.com/t5/Design-and-Debug-Techniques-Blog/...

2020-10-30 08:00:00 6

转载 创建 Vitis 加速平台第 2 部分:在 PetaLinux 中为加速平台创建软件工程

作者:Stephen MacMahon来源:赛灵思中文社区论坛这是《创建 Vitis 加速平台》系列的第 2 篇博文。在前文中,我们讲解了如何创建硬件以及如何通过 XSA 将元数据 (m...

2020-10-30 08:00:00 20

原创 观察 AXI4-Lite 总线信号

在《AXI-Lite 自定义IP》章节基础上,添加ila\vio等调试ip,完成后的BD如下图:图4‑53 添加测试信号加载到SDK,并且在Vivado中连接到开发板。Trigger Se...

2020-10-27 08:00:00 21

原创 AXI_lite代码简解(四)-观察 AXI4-Lite 总线信号

观察 AXI4-Lite 总线信号  在《AXI-Lite 自定义IP》章节基础上,添加ila\vio等调试ip,完成后的BD如下图:                    图4 53 添加测试信号  加载到SDK,并且在Vivado中连接到开发板。  Trigger Setup,点击“+”,选择 AXI_WVALID,双击添加。设置 Radix 为 B,触发条件 Value 为 1。                    图4 54 添加信号设置触发位置为 512          .

2020-10-26 22:24:57 10483

转载 国外FPGA四大巨头简介

FPGA (Field Programmable Gate Array)现场可编程门阵列,是在硅片上预先设计实现的具有可编程特性的集成电路,它能够按照设计人员的需求配置为指定的电路结构,让...

2020-10-25 09:00:00 37

转载 【转载】让你的GitHub下载飞速提升到2M/s以上

2020年7月27日整理发布多种GitHub加速方式!转载自:https://code.pingbook.top/blog/2020/How-To-Speed-Github.htmlGitHub 镜像访问这里提供两个最常用的镜像地址:https://github.com.cnpmjs.orghttps://hub.fastgit.org也就是说上面的镜像就是一个克隆版的Github,你可以访问上面的镜像网站,网站的内容跟Github是完整同步的镜像,然后在这个网站里面进行下载克隆等操作。

2020-10-22 01:07:08 130

原创 [Xilinx]在JTAG下载器连接时FPGA不加载flash里的程序

最近群里有很多人遇到上述的情况,一直觉得不可思议,以前没有遇到这种情况,如果是很常见的情况,那官网一定有人反馈,如果是极特别的情况,那么也就只能按照BUG处理了。很幸运,官网有很多人反馈类...

2020-10-21 08:00:00 16

原创 AXI-Lite 自定义IP

AXI-Lite 自定义IP目的:通过嵌入式软核或者硬核通过AXI_Lite接口(Master)控制FPGA端引脚的GPIO。实现框图:图4‑50 自定义IP应用框图按照AXI互联机制我们...

2020-10-19 08:00:00 15

转载 IC技术圈期刊 2020年第10期

IC技术圈期刊内容涵盖FPGA、前端、验证、后端、自动化、模拟、求职、管理等IC技术领域,欢迎阅读,欢迎投稿。当我们做后仿时我们究竟在仿些什么(四)#验证#后仿#门级仿真点击阅读ics...

2020-10-18 20:00:00 10

原创 AXI_lite代码简解(三)-AXI-LITE 自定义IP

AXI-LITE 自定义IP目的:通过嵌入式软核或者硬核通过AXI_Lite接口(Master)控制FPGA端引脚的GPIO。实现框图:                  图4 50 自定义IP应用框图按照AXI互联机制我们知道,我们的自定义IP是通过AXI_Interconnect连接到Master端,整体的框图也比较简单,为了验证方便我们只按照红色线路径进行测试。自定义的IP也比较简单,是直接在上面两节的基础上修改几个参数即可。我们知道软核或者硬核通过接口向自定义IP写数据时,是通过sl

2020-10-18 16:40:45 3576

转载 在Vivado下利用Tcl实现IP的高效管理

在Vivado下,有两种方式管理IP。一种是创建FPGA工程之后,在当前工程中选中IP Catalog,生成所需IP,这时相应的IP会被自动添加到当前工程中;另一种是利用Manage IP...

2020-10-15 08:00:00 27

转载 赛灵思最大的 FPGA VU19P 批量发货了!

准备好做钥匙扣了吗?您准备开发面向未来的最复杂、最具创新水平的未来新技术吗?我们能帮助您实现愿望。今天,我们很荣幸地宣布,赛灵思最大的 FPGA,即 Virtex UltraScale+ ...

2020-10-13 23:59:00 6

转载 Quartus 各版本器件支持列表

参考:http://www.ithinktech.cn/index.php?c=content&a=show&id=786

2020-10-13 20:18:04 1675

原创 AXI_lite代码简解-AXI-Lite 源码分析

AXI-Lite 源码分析对于使用AXI总线,最开始肯定要了解顶层接口定义,这样才能针对顶层接口进行调用和例化,打开axi_lite_v1_0.v文件,第一段就是顶层的接口定义:代码4‑1...

2020-10-11 09:00:00 34

原创 AXI_lite代码简解(二)-AXI-Lite 源码分析

AXI-Lite 源码分析  对于使用AXI总线,最开始肯定要了解顶层接口定义,这样才能针对顶层接口进行调用和例化,打开axi_lite_v1_0.v文件,第一段就是顶层的接口定义:代码4 1 axi_lite接口定义1. // Ports of Axi Slave Bus Interface S00_AXI 2. input wire s00_axi_aclk, 3. input wire s00_axi_aresetn, 4. input wire [C_S00_AXI_A

2020-10-10 22:11:20 636

原创 AXI_lite代码简解-查看源码

查看源码1、要看到AXI-Lite的源码,我们先要自定义一个AXI-Lite的IP,新建工程之后,选择,菜单栏->Tools->Creat and Package IP:图4‑...

2020-10-10 08:00:00 14

原创 AXI_lite代码简解(一)-查看源码

查看源码1、要看到AXI-Lite的源码,我们先要自定义一个AXI-Lite的IP,新建工程之后,选择,菜单栏->Tools->Creat and Package IP:            图4‑43 Creat and Package IP2、选择NEXT            图4‑44 选择NEXT3、选择Create AXI4 Peripheral,然后Next:            图4‑45 选择Create AXI4 Peripheral,然后Next4.

2020-10-09 20:53:30 341

转载 重磅!芯片世纪并购?AMD或将收购赛灵思!

据《华尔街日报》最新报道,超微半导体(AMD)正就收购芯片制造商赛灵思(Xilinx)展开深入谈判,最快可能在下周完成谈判。考虑进收购溢价因素,该项并购估值可能超过300亿美元,堪称...

2020-10-09 13:40:20 3

转载 学会使用Hdlbits网页版Verilog代码仿真验证平台

大家推荐一款网页版的 Verilog代码编辑仿真验证平台,这个平台是国外的一家开源FPGA学习网站,通过“https://hdlbits.01xz.net/wiki/Main_Page”地...

2020-10-06 09:00:00 9

原创 Xilinx 7系列FPGA Multiboot介绍-远程更新

在远程更新的时候,有时候需要双镜像来保护设计的稳定性。在进行更新设计的时候,只更新一个镜像,另一个镜像在部署之前就测试过没问题并不再更新。当更新出错时,通过不被更新的镜像进行一些操作,可以...

2020-10-04 09:00:00 51

原创 ​Altera FPGA 远程升级有关的几个IP的使用

Altera FPGA 远程升级有关的几个IP的使用  在做在线远程升级的时候,一般需要两步:1、将数据写到外挂的flash中。2重新启动FPGA配置。不过要做到远程升级,一般需要在原始...

2020-10-04 09:00:00 16

转载 【OpenFPGA】值此月圆中秋·普天同庆华诞;祝大家中秋快乐,阖家团圆

天涯共此时值此月圆中秋·普天同庆华诞祝大家中秋快乐,阖家团圆天涯共此时我的思念是圆的,八月中秋的月亮,也是最亮最圆的,无论山多高,海多宽,天涯海角都能看见它,在这样的夜晚,会想起什么?——...

2020-10-01 03:00:00 5

数据传输中耦合电容的选择与应用

数据传输中耦合电容的选择与应用 从理论上进行分析在告诉传输链路中AC耦合电容的作用和选择相关理论

2019-03-28

2口手动KVM原理图.pdf

参考原理图

2021-08-02

ModelSim SE 10.4安装破解教程

ModelSim SE 10.4安装破解教程

2018-10-31

基于VIP_Board Big的FPGA入门进阶及图像处理算法开发教程-V3.0

基于VIP_Board Big的FPGA入门进阶及图像处理算法开发教程-V3.0 这是一款相对完善的视频图像处理的开发板配套的资源,详细的配套光盘,我会在我博客里放出来:基于FPGA的图像边缘检测系统

2018-10-18

FPGA芯片命名规则

FPGA芯片命名规则

2017-08-25

Xilinx和Altera-FPGA的基本逻辑单元对比

Xilinx和Altera-FPGA的基本逻辑单元对比,内有举例说明。

2017-08-15

手把手教你学FPGA设计:基于大道至简的至简设计法

手把手教你学FPGA设计:基于大道至简的至简设计法 不带书签,只作为学习用途,请购买正版书籍。

2018-10-18

Tcl_Tk入门经典(第2版)

Tcl/Tk入门经典》介绍了Tcl语言、Tk工具集以及Tcl和C语言结合编程。《Tcl/Tk入门经典》的第I部分首先介绍了Tcl语言的基本概念和基础知识。第II部分集中介绍如何使用Tk工具集开发图形用户界面。第Ⅲ部分讲解了如何结合Tcl和C语言进行程序开发。 《Tcl/Tk入门经典》原第一作者是Tcl的创造者,所以本书内容覆盖了Tcl语言的主要方面,且示例程序丰富,大部分示例代码可在Tcl安装目录的demos目录中找到。《Tcl/Tk入门经典》适用于Tcl语言的初学者,也适用于希望了解Tcl 8.5版和Tk 8.5版新特性的读者。

2018-09-05

ALTERA器件选型指南(中文版)

ALTERA器件选型指南(中文版)

2017-08-20

CORDIC算法

CORDIC算法的资源 包括Xilinx出的关于算法的介绍和相关的仿真和Verilog代码,还有本人收集的关于CORDIC算法写的比较好的中文书的一节

2018-10-29

【南京米联】《ZYNQ修炼秘籍》2017-03-02

【南京米联】《ZYNQ修炼秘籍》

2017-08-29

NRF24L01板载PCB天线设计

NRF24L01板载PCB天线设计,包括官方的文档,相关PCB设计说明。还有自己的原理图和PCB源文件,可以直接添加到自己PCB上使用。

2017-09-24

xapp623-FPGA电源设计应用指导

xapp623-FPGA电源设计应用指导-xilinx官方电源设计指导白皮书 这个是中文版的,需要英文版的把资源名称复制百度就可以找到了,也可以私信我

2018-07-18

IMX214_RegisterMap_2.0.0

IMX214_RegisterMap_2.0.0

2019-04-01

Cyclone V系列器件

Cyclone V系列器件介绍及选型

2017-08-20

电源完整性分析(于争博士)

电源完整性分析(于争博士) 里面通俗易懂的讲解了电源完整性的问题,并没有太多数学计算的东西,举例也很简单。

2017-09-20

基于FPGA的CORDIC算法实现-Vivado Verilog

基于FPGA的CORDIC算法实现-Vivado2018开发环境, Verilog语言编写,带TB文件,已经在ModelSim中仿真通过。

2018-11-01

PLL 锁相环基本原理

PLL 锁相环基本原理,ADI官方MT-086锁相环(PLL)基本原理,中文版,写的非常详细,有利于理解相关理论。

2018-10-10

基于状态机的简易RISC CPU设计

基于状态机的简易RISC CPU设计,包括夏宇闻老师Verilog数字系统设计中的文档说明和源码,很详细哟

2017-11-01

System Generator实现CORDIC算法工程文件

System Generator实现CORDIC算法工程文件 详细内容,请参照博客:https://blog.csdn.net/Pieces_thinking/article/details/83745331 请看完之后再下载

2018-11-05

OpenMIPS快速入门手册(实践版)

OpenMIPS快速入门手册(实践版)主要包含相关技术的规范,以及OpenMIPS引脚的定义与使用 OpenMIPS快速入门手册(实践版)

2017-09-11

基于FPGA的深度学习加速器设计与实现

现场可编程门阵列FPGA作为常用的加速手段之一,具有高性能、低功耗、 可编程等特点。本文采用FPGA设计针对深度学习通用计算部分的加速器,主要工作有: 1)、分析深度神经网络、卷积神经网络的预测过程和训练过程算法共性和特 性,并以此为基础设计FPGA运算单元,算法包括前向计算算法、本地预训练算法和全局训练算法。 2)、根据FPGA资源情况设计基本运算单元,包括前向计算单元和权值更新 运算单元。运算单元均进行可配置和流水线设计,在适应不同规模深度学习神经 网络的同时具有高吞吐率。 3)、分析FPGA加速器的上层框架和数据通路,编写linux操作系统下驱动 程序以及面向上层用户简单易用的调用接口。 4)、通过大量实验测试分析影响加速器性能的各种因素,得到加速器的性能、能耗趋势,使用测试数据集与CPU、GPU平台进行性能、功率、能耗等参数对比,分析FPGA实现的优劣性。

2018-06-25

Xilinx芯片选型手册

Xilinx芯片选型手册

2017-08-20

MobBob资源(2)

MobBob资源 手机安装文件

2017-08-19

DesignCon2018信号完整性宝典

DesignCon2018信号完整性宝典

2019-02-12

AXI_Stream_TEST.7z

请先看https://suisuisi.blog.csdn.net/article/details/109455845 后在下载,谢谢

2020-11-02

稳压二极管的使用

稳压二极管的使用

2017-10-24

门磁开关磁接近开关原理

门磁开关磁接近开关原理 包括干簧管和简单的基于干簧管的门磁报警器原理

2018-11-14

FPGA知识图谱-PDF格式

请各位 先到 https://blog.csdn.net/Pieces_thinking/article/details/88387874 看一下眼在下载

2019-03-11

笔试面试精华题目(修改版)

笔试面试精华题目。主要是硬件工程师笔试和面试过程中常见的题目,命中率百分之80左右。

2017-12-01

ALTERA器件选型指南(英文版)

ALTERA器件选型指南(英文版)

2017-08-20

树莓派实现远程监控

树莓派实现远程监控

2017-08-17

ADI高速、混合、微弱信号布线指南(中文对照

ADI高速、混合、微弱信号布线指南(中文对照) 资料写的很详细

2018-08-13

智能无线电技术.pdf

智能无线电技术

2021-04-11

CORDIC配套实例

黑金CORDIC教程,配套实例,工程实例,带仿真文件,可以直接用,具体教程,请搜索我的资源

2018-09-26

跑在树莓派上智能家居雏形

跑在树莓派上智能家居雏形,内有说明文档及软件

2017-08-17

场效应管(FET)知识点释义

场效应管(FET)知识点释义

2017-08-29

差分阻抗的定义及由来

差分阻抗的定义及由来,包括两个文档,一个是英文原版的文档,一个是翻译好的文档。PS:7z的压缩包,最好用7z压缩软件进行解压。

2017-10-17

内存及其与CPU连接

内存及其与CPU连接,很经典,主要例子举的非常通俗易懂。

2017-12-03

jitter和skew-笔记

jitter和skew介绍与区别

2017-08-16

如何看待硬件工程师这个职位?

发表于 2017-08-29 最后回复 2020-08-19

碎碎思的留言板

发表于 2020-01-02 最后回复 2020-05-19

博客粉丝咋变成0了

发表于 2019-06-17 最后回复 2019-08-06

修改以前的博客图片不显示

发表于 2018-12-20 最后回复 2019-05-09

博客编辑 图片显示的问题

发表于 2018-11-15 最后回复 2018-11-21

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